ece385_finalprj.merge.rpt

Partition Merge report for ece385_finalprj
Thu Nov 28 15:44:11 2019
Quartus Prime Version 18.1.0 Build 625 09/12/2018 SJ Lite Edition


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; Table of Contents ;
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  1. Legal Notice
  2. Partition Merge Summary
  3. Partition Merge Netlist Types Used
  4. Partition Merge Partition Statistics
  5. Partition Merge Partition Pin Processing
  6. Partition Merge Resource Usage Summary
  7. Partition Merge RAM Summary
  8. Partition Merge DSP Block Usage Summary
  9. Partition Merge Messages



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; Legal Notice ;
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Copyright (C) 2018  Intel Corporation. All rights reserved.
Your use of Intel Corporation's design tools, logic functions 
and other software and tools, and its AMPP partner logic 
functions, and any output files from any of the foregoing 
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; Partition Merge Summary                                                          ;
+------------------------------------+---------------------------------------------+
; Partition Merge Status             ; Successful - Thu Nov 28 15:44:11 2019       ;
; Quartus Prime Version              ; 18.1.0 Build 625 09/12/2018 SJ Lite Edition ;
; Revision Name                      ; ece385_finalprj                             ;
; Top-level Entity Name              ; final_top                                   ;
; Family                             ; Cyclone IV E                                ;
; Total logic elements               ; 24,419                                      ;
;     Total combinational functions  ; 22,906                                      ;
;     Dedicated logic registers      ; 3,270                                       ;
; Total registers                    ; 3270                                        ;
; Total pins                         ; 194                                         ;
; Total virtual pins                 ; 0                                           ;
; Total memory bits                  ; 26,624                                      ;
; Embedded Multiplier 9-bit elements ; 50                                          ;
; Total PLLs                         ; 1                                           ;
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; Partition Merge Netlist Types Used                                                                                            ;
+--------------------------------+----------------+-------------------+------------------------+--------------------------------+
; Partition Name                 ; Partition Type ; Netlist Type Used ; Netlist Type Requested ; Partition Contents             ;
+--------------------------------+----------------+-------------------+------------------------+--------------------------------+
; Top                            ; User-created   ; Source File       ; Source File            ;                                ;
; sld_hub:auto_hub               ; Auto-generated ; Post-Synthesis    ; Post-Synthesis         ; sld_hub:auto_hub               ;
; hard_block:auto_generated_inst ; Auto-generated ; Source File       ; Source File            ; hard_block:auto_generated_inst ;
+--------------------------------+----------------+-------------------+------------------------+--------------------------------+


+---------------------------------------------------------------------------------------------------------+
; Partition Merge Partition Statistics                                                                    ;
+---------------------------------------------+-------+------------------+--------------------------------+
; Statistic                                   ; Top   ; sld_hub:auto_hub ; hard_block:auto_generated_inst ;
+---------------------------------------------+-------+------------------+--------------------------------+
; Estimated Total logic elements              ; 24251 ; 168              ; 0                              ;
;                                             ;       ;                  ;                                ;
; Total combinational functions               ; 22756 ; 150              ; 0                              ;
; Logic element usage by number of LUT inputs ;       ;                  ;                                ;
;     -- 4 input functions                    ; 8229  ; 72               ; 0                              ;
;     -- 3 input functions                    ; 11661 ; 36               ; 0                              ;
;     -- <=2 input functions                  ; 2866  ; 42               ; 0                              ;
;                                             ;       ;                  ;                                ;
; Logic elements by mode                      ;       ;                  ;                                ;
;     -- normal mode                          ; 13113 ; 142              ; 0                              ;
;     -- arithmetic mode                      ; 9643  ; 8                ; 0                              ;
;                                             ;       ;                  ;                                ;
; Total registers                             ; 3185  ; 85               ; 0                              ;
;     -- Dedicated logic registers            ; 3185  ; 85               ; 0                              ;
;     -- I/O registers                        ; 0     ; 0                ; 0                              ;
;                                             ;       ;                  ;                                ;
; Virtual pins                                ; 0     ; 0                ; 0                              ;
; I/O pins                                    ; 194   ; 0                ; 0                              ;
; Embedded Multiplier 9-bit elements          ; 50    ; 0                ; 0                              ;
; Total memory bits                           ; 26624 ; 0                ; 0                              ;
; Total RAM block bits                        ; 0     ; 0                ; 0                              ;
; JTAG                                        ; 1     ; 0                ; 0                              ;
; PLL                                         ; 0     ; 0                ; 1                              ;
;                                             ;       ;                  ;                                ;
; Connections                                 ;       ;                  ;                                ;
;     -- Input Connections                    ; 1443  ; 125              ; 2                              ;
;     -- Registered Input Connections         ; 1230  ; 95               ; 0                              ;
;     -- Output Connections                   ; 271   ; 174              ; 1125                           ;
;     -- Registered Output Connections        ; 7     ; 174              ; 0                              ;
;                                             ;       ;                  ;                                ;
; Internal Connections                        ;       ;                  ;                                ;
;     -- Total Connections                    ; 87303 ; 932              ; 1128                           ;
;     -- Registered Connections               ; 13903 ; 664              ; 0                              ;
;                                             ;       ;                  ;                                ;
; External Connections                        ;       ;                  ;                                ;
;     -- Top                                  ; 290   ; 297              ; 1127                           ;
;     -- sld_hub:auto_hub                     ; 297   ; 2                ; 0                              ;
;     -- hard_block:auto_generated_inst       ; 1127  ; 0                ; 0                              ;
;                                             ;       ;                  ;                                ;
; Partition Interface                         ;       ;                  ;                                ;
;     -- Input Ports                          ; 41    ; 62               ; 2                              ;
;     -- Output Ports                         ; 148   ; 79               ; 5                              ;
;     -- Bidir Ports                          ; 48    ; 0                ; 0                              ;
;                                             ;       ;                  ;                                ;
; Registered Ports                            ;       ;                  ;                                ;
;     -- Registered Input Ports               ; 0     ; 3                ; 0                              ;
;     -- Registered Output Ports              ; 0     ; 40               ; 0                              ;
;                                             ;       ;                  ;                                ;
; Port Connectivity                           ;       ;                  ;                                ;
;     -- Input Ports driven by GND            ; 0     ; 2                ; 0                              ;
;     -- Output Ports driven by GND           ; 0     ; 29               ; 0                              ;
;     -- Input Ports driven by VCC            ; 0     ; 0                ; 0                              ;
;     -- Output Ports driven by VCC           ; 0     ; 0                ; 0                              ;
;     -- Input Ports with no Source           ; 0     ; 47               ; 0                              ;
;     -- Output Ports with no Source          ; 0     ; 0                ; 0                              ;
;     -- Input Ports with no Fanout           ; 0     ; 52               ; 0                              ;
;     -- Output Ports with no Fanout          ; 0     ; 59               ; 0                              ;
+---------------------------------------------+-------+------------------+--------------------------------+
Note: Resource usage numbers presented for Partitions containing post-synthesis logic are estimates.  For Partitions containing post-fit logic, resource usage numbers are accurate based on previous placement information.  Actual Fitter results may vary depending on current Fitter Preservation Level assignments.


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; Partition Merge Partition Pin Processing                                                                                                                                                                                                                                           ;
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+-----------+---------------+----------+--------------------------------------------+
; Name                                                                                                                                                                                           ; Partition ; Type          ; Location ; Status                                     ;
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+-----------+---------------+----------+--------------------------------------------+
; CLOCK_50                                                                                                                                                                                       ; Top       ; Input Port    ; n/a      ;                                            ;
;     -- CLOCK_50                                                                                                                                                                                ; Top       ; Input Pad     ; Unplaced ; Synthesized                                ;
;     -- CLOCK_50~input                                                                                                                                                                          ; Top       ; Input Buffer  ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_ADDR[0]                                                                                                                                                                                   ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_ADDR[0]                                                                                                                                                                            ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_ADDR[0]~output                                                                                                                                                                     ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_ADDR[10]                                                                                                                                                                                  ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_ADDR[10]                                                                                                                                                                           ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_ADDR[10]~output                                                                                                                                                                    ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_ADDR[11]                                                                                                                                                                                  ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_ADDR[11]                                                                                                                                                                           ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_ADDR[11]~output                                                                                                                                                                    ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_ADDR[12]                                                                                                                                                                                  ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_ADDR[12]                                                                                                                                                                           ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_ADDR[12]~output                                                                                                                                                                    ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_ADDR[1]                                                                                                                                                                                   ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_ADDR[1]                                                                                                                                                                            ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_ADDR[1]~output                                                                                                                                                                     ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_ADDR[2]                                                                                                                                                                                   ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_ADDR[2]                                                                                                                                                                            ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_ADDR[2]~output                                                                                                                                                                     ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_ADDR[3]                                                                                                                                                                                   ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_ADDR[3]                                                                                                                                                                            ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_ADDR[3]~output                                                                                                                                                                     ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_ADDR[4]                                                                                                                                                                                   ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_ADDR[4]                                                                                                                                                                            ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_ADDR[4]~output                                                                                                                                                                     ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_ADDR[5]                                                                                                                                                                                   ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_ADDR[5]                                                                                                                                                                            ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_ADDR[5]~output                                                                                                                                                                     ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_ADDR[6]                                                                                                                                                                                   ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_ADDR[6]                                                                                                                                                                            ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_ADDR[6]~output                                                                                                                                                                     ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_ADDR[7]                                                                                                                                                                                   ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_ADDR[7]                                                                                                                                                                            ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_ADDR[7]~output                                                                                                                                                                     ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_ADDR[8]                                                                                                                                                                                   ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_ADDR[8]                                                                                                                                                                            ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_ADDR[8]~output                                                                                                                                                                     ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_ADDR[9]                                                                                                                                                                                   ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_ADDR[9]                                                                                                                                                                            ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_ADDR[9]~output                                                                                                                                                                     ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_BA[0]                                                                                                                                                                                     ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_BA[0]                                                                                                                                                                              ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_BA[0]~output                                                                                                                                                                       ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_BA[1]                                                                                                                                                                                     ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_BA[1]                                                                                                                                                                              ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_BA[1]~output                                                                                                                                                                       ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_CAS_N                                                                                                                                                                                     ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_CAS_N                                                                                                                                                                              ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_CAS_N~output                                                                                                                                                                       ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_CKE                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_CKE                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_CKE~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_CLK                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_CLK                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_CLK~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_CS_N                                                                                                                                                                                      ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_CS_N                                                                                                                                                                               ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_CS_N~output                                                                                                                                                                        ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQM[0]                                                                                                                                                                                    ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_DQM[0]                                                                                                                                                                             ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQM[0]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQM[1]                                                                                                                                                                                    ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_DQM[1]                                                                                                                                                                             ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQM[1]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQM[2]                                                                                                                                                                                    ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_DQM[2]                                                                                                                                                                             ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQM[2]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQM[3]                                                                                                                                                                                    ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_DQM[3]                                                                                                                                                                             ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQM[3]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[0]                                                                                                                                                                                     ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[0]                                                                                                                                                                              ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[0]~output                                                                                                                                                                       ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[10]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[10]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[10]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[11]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[11]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[11]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[12]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[12]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[12]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[13]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[13]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[13]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[14]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[14]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[14]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[15]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[15]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[15]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[16]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[16]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[16]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[17]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[17]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[17]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[18]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[18]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[18]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[19]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[19]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[19]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[1]                                                                                                                                                                                     ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[1]                                                                                                                                                                              ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[1]~output                                                                                                                                                                       ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[20]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[20]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[20]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[21]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[21]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[21]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[22]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[22]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[22]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[23]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[23]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[23]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[24]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[24]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[24]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[25]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[25]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[25]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[26]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[26]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[26]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[27]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[27]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[27]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[28]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[28]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[28]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[29]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[29]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[29]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[2]                                                                                                                                                                                     ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[2]                                                                                                                                                                              ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[2]~output                                                                                                                                                                       ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[30]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[30]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[30]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[31]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[31]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[31]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[3]                                                                                                                                                                                     ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[3]                                                                                                                                                                              ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[3]~output                                                                                                                                                                       ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[4]                                                                                                                                                                                     ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[4]                                                                                                                                                                              ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[4]~output                                                                                                                                                                       ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[5]                                                                                                                                                                                     ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[5]                                                                                                                                                                              ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[5]~output                                                                                                                                                                       ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[6]                                                                                                                                                                                     ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[6]                                                                                                                                                                              ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[6]~output                                                                                                                                                                       ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[7]                                                                                                                                                                                     ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[7]                                                                                                                                                                              ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[7]~output                                                                                                                                                                       ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[8]                                                                                                                                                                                     ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[8]                                                                                                                                                                              ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[8]~output                                                                                                                                                                       ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_DQ[9]                                                                                                                                                                                     ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- DRAM_DQ[9]                                                                                                                                                                              ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- DRAM_DQ[9]~output                                                                                                                                                                       ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_RAS_N                                                                                                                                                                                     ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_RAS_N                                                                                                                                                                              ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_RAS_N~output                                                                                                                                                                       ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; DRAM_WE_N                                                                                                                                                                                      ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- DRAM_WE_N                                                                                                                                                                               ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- DRAM_WE_N~output                                                                                                                                                                        ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX0[0]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX0[0]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX0[0]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX0[1]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX0[1]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX0[1]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX0[2]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX0[2]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX0[2]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX0[3]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX0[3]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX0[3]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX0[4]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX0[4]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX0[4]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX0[5]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX0[5]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX0[5]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX0[6]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX0[6]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX0[6]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX1[0]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX1[0]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX1[0]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX1[1]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX1[1]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX1[1]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX1[2]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX1[2]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX1[2]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX1[3]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX1[3]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX1[3]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX1[4]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX1[4]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX1[4]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX1[5]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX1[5]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX1[5]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX1[6]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX1[6]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX1[6]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX2[0]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX2[0]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX2[0]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX2[1]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX2[1]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX2[1]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX2[2]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX2[2]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX2[2]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX2[3]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX2[3]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX2[3]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX2[4]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX2[4]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX2[4]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX2[5]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX2[5]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX2[5]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX2[6]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX2[6]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX2[6]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX3[0]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX3[0]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX3[0]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX3[1]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX3[1]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX3[1]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX3[2]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX3[2]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX3[2]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX3[3]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX3[3]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX3[3]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX3[4]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX3[4]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX3[4]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX3[5]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX3[5]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX3[5]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX3[6]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX3[6]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX3[6]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX4[0]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX4[0]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX4[0]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX4[1]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX4[1]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX4[1]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX4[2]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX4[2]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX4[2]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX4[3]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX4[3]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX4[3]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX4[4]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX4[4]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX4[4]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX4[5]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX4[5]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX4[5]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX4[6]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX4[6]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX4[6]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX5[0]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX5[0]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX5[0]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX5[1]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX5[1]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX5[1]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX5[2]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX5[2]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX5[2]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX5[3]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX5[3]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX5[3]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX5[4]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX5[4]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX5[4]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX5[5]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX5[5]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX5[5]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX5[6]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX5[6]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX5[6]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX6[0]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX6[0]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX6[0]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX6[1]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX6[1]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX6[1]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX6[2]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX6[2]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX6[2]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX6[3]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX6[3]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX6[3]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX6[4]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX6[4]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX6[4]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX6[5]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX6[5]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX6[5]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX6[6]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX6[6]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX6[6]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX7[0]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX7[0]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX7[0]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX7[1]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX7[1]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX7[1]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX7[2]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX7[2]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX7[2]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX7[3]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX7[3]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX7[3]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX7[4]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX7[4]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX7[4]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX7[5]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX7[5]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX7[5]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; HEX7[6]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- HEX7[6]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- HEX7[6]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; KEY[0]                                                                                                                                                                                         ; Top       ; Input Port    ; n/a      ;                                            ;
;     -- KEY[0]                                                                                                                                                                                  ; Top       ; Input Pad     ; Unplaced ; Synthesized                                ;
;     -- KEY[0]~input                                                                                                                                                                            ; Top       ; Input Buffer  ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; KEY[1]                                                                                                                                                                                         ; Top       ; Input Port    ; n/a      ;                                            ;
;     -- KEY[1]                                                                                                                                                                                  ; Top       ; Input Pad     ; Unplaced ; Synthesized                                ;
;     -- KEY[1]~input                                                                                                                                                                            ; Top       ; Input Buffer  ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDG[0]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDG[0]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDG[0]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDG[1]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDG[1]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDG[1]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDG[2]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDG[2]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDG[2]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDG[3]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDG[3]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDG[3]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDG[4]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDG[4]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDG[4]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDG[5]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDG[5]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDG[5]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDG[6]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDG[6]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDG[6]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDG[7]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDG[7]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDG[7]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDR[0]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDR[0]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDR[0]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDR[10]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDR[10]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDR[10]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDR[11]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDR[11]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDR[11]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDR[12]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDR[12]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDR[12]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDR[13]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDR[13]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDR[13]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDR[14]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDR[14]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDR[14]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDR[15]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDR[15]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDR[15]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDR[16]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDR[16]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDR[16]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDR[17]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDR[17]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDR[17]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDR[1]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDR[1]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDR[1]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDR[2]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDR[2]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDR[2]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDR[3]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDR[3]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDR[3]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDR[4]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDR[4]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDR[4]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDR[5]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDR[5]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDR[5]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDR[6]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDR[6]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDR[6]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDR[7]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDR[7]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDR[7]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDR[8]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDR[8]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDR[8]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; LEDR[9]                                                                                                                                                                                        ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- LEDR[9]                                                                                                                                                                                 ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- LEDR[9]~output                                                                                                                                                                          ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_ADDR[0]                                                                                                                                                                                    ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- OTG_ADDR[0]                                                                                                                                                                             ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- OTG_ADDR[0]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_ADDR[1]                                                                                                                                                                                    ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- OTG_ADDR[1]                                                                                                                                                                             ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- OTG_ADDR[1]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_CS_N                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- OTG_CS_N                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- OTG_CS_N~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_DATA[0]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- OTG_DATA[0]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- OTG_DATA[0]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_DATA[10]                                                                                                                                                                                   ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- OTG_DATA[10]                                                                                                                                                                            ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- OTG_DATA[10]~output                                                                                                                                                                     ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_DATA[11]                                                                                                                                                                                   ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- OTG_DATA[11]                                                                                                                                                                            ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- OTG_DATA[11]~output                                                                                                                                                                     ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_DATA[12]                                                                                                                                                                                   ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- OTG_DATA[12]                                                                                                                                                                            ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- OTG_DATA[12]~output                                                                                                                                                                     ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_DATA[13]                                                                                                                                                                                   ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- OTG_DATA[13]                                                                                                                                                                            ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- OTG_DATA[13]~output                                                                                                                                                                     ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_DATA[14]                                                                                                                                                                                   ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- OTG_DATA[14]                                                                                                                                                                            ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- OTG_DATA[14]~output                                                                                                                                                                     ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_DATA[15]                                                                                                                                                                                   ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- OTG_DATA[15]                                                                                                                                                                            ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- OTG_DATA[15]~output                                                                                                                                                                     ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_DATA[1]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- OTG_DATA[1]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- OTG_DATA[1]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_DATA[2]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- OTG_DATA[2]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- OTG_DATA[2]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_DATA[3]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- OTG_DATA[3]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- OTG_DATA[3]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_DATA[4]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- OTG_DATA[4]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- OTG_DATA[4]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_DATA[5]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- OTG_DATA[5]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- OTG_DATA[5]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_DATA[6]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- OTG_DATA[6]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- OTG_DATA[6]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_DATA[7]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- OTG_DATA[7]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- OTG_DATA[7]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_DATA[8]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- OTG_DATA[8]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- OTG_DATA[8]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_DATA[9]                                                                                                                                                                                    ; Top       ; Bidir Port    ; n/a      ;                                            ;
;     -- OTG_DATA[9]                                                                                                                                                                             ; Top       ; Bidir Pad     ; Unplaced ; Synthesized                                ;
;     -- OTG_DATA[9]~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Preserved from Synthesis Netlist (WYSIWYG) ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_INT                                                                                                                                                                                        ; Top       ; Input Port    ; n/a      ;                                            ;
;     -- OTG_INT                                                                                                                                                                                 ; Top       ; Input Pad     ; Unplaced ; Synthesized                                ;
;     -- OTG_INT~input                                                                                                                                                                           ; Top       ; Input Buffer  ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_RD_N                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- OTG_RD_N                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- OTG_RD_N~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_RST_N                                                                                                                                                                                      ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- OTG_RST_N                                                                                                                                                                               ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- OTG_RST_N~output                                                                                                                                                                        ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; OTG_WR_N                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- OTG_WR_N                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- OTG_WR_N~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_BLANK_N                                                                                                                                                                                    ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_BLANK_N                                                                                                                                                                             ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_BLANK_N~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_B[0]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_B[0]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_B[0]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_B[1]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_B[1]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_B[1]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_B[2]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_B[2]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_B[2]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_B[3]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_B[3]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_B[3]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_B[4]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_B[4]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_B[4]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_B[5]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_B[5]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_B[5]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_B[6]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_B[6]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_B[6]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_B[7]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_B[7]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_B[7]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_CLK_CLK                                                                                                                                                                                    ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_CLK_CLK                                                                                                                                                                             ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_CLK_CLK~output                                                                                                                                                                      ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_G[0]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_G[0]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_G[0]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_G[1]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_G[1]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_G[1]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_G[2]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_G[2]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_G[2]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_G[3]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_G[3]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_G[3]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_G[4]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_G[4]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_G[4]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_G[5]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_G[5]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_G[5]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_G[6]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_G[6]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_G[6]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_G[7]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_G[7]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_G[7]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_HS                                                                                                                                                                                         ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_HS                                                                                                                                                                                  ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_HS~output                                                                                                                                                                           ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_R[0]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_R[0]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_R[0]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_R[1]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_R[1]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_R[1]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_R[2]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_R[2]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_R[2]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_R[3]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_R[3]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_R[3]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_R[4]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_R[4]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_R[4]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_R[5]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_R[5]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_R[5]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_R[6]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_R[6]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_R[6]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_R[7]                                                                                                                                                                                       ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_R[7]                                                                                                                                                                                ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_R[7]~output                                                                                                                                                                         ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_SYNC_N                                                                                                                                                                                     ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_SYNC_N                                                                                                                                                                              ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_SYNC_N~output                                                                                                                                                                       ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; VGA_VS                                                                                                                                                                                         ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- VGA_VS                                                                                                                                                                                  ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- VGA_VS~output                                                                                                                                                                           ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; altera_reserved_tck                                                                                                                                                                            ; Top       ; Input Port    ; n/a      ;                                            ;
;     -- altera_reserved_tck                                                                                                                                                                     ; Top       ; Input Pad     ; Unplaced ; Synthesized                                ;
;     -- altera_reserved_tck~input                                                                                                                                                               ; Top       ; Input Buffer  ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; altera_reserved_tdi                                                                                                                                                                            ; Top       ; Input Port    ; n/a      ;                                            ;
;     -- altera_reserved_tdi                                                                                                                                                                     ; Top       ; Input Pad     ; Unplaced ; Synthesized                                ;
;     -- altera_reserved_tdi~input                                                                                                                                                               ; Top       ; Input Buffer  ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; altera_reserved_tdo                                                                                                                                                                            ; Top       ; Output Port   ; n/a      ;                                            ;
;     -- altera_reserved_tdo                                                                                                                                                                     ; Top       ; Output Pad    ; Unplaced ; Synthesized                                ;
;     -- altera_reserved_tdo~output                                                                                                                                                              ; Top       ; Output Buffer ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; altera_reserved_tms                                                                                                                                                                            ; Top       ; Input Port    ; n/a      ;                                            ;
;     -- altera_reserved_tms                                                                                                                                                                     ; Top       ; Input Pad     ; Unplaced ; Synthesized                                ;
;     -- altera_reserved_tms~input                                                                                                                                                               ; Top       ; Input Buffer  ; Unplaced ; Synthesized                                ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_jtag_uart_0_final_soc_jtag_uart_0_alt_jtag_atlantic_clr                                                                                                                ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_jtag_uart_0_final_soc_jtag_uart_0_alt_jtag_atlantic_ena                                                                                                                ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_jtag_uart_0_final_soc_jtag_uart_0_alt_jtag_atlantic_ir_in_0_                                                                                                           ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_jtag_uart_0_final_soc_jtag_uart_0_alt_jtag_atlantic_ir_out_0_                                                                                                          ; Top       ; Output Port   ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_jtag_uart_0_final_soc_jtag_uart_0_alt_jtag_atlantic_jtag_state_cdr                                                                                                     ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_jtag_uart_0_final_soc_jtag_uart_0_alt_jtag_atlantic_jtag_state_rti                                                                                                     ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_jtag_uart_0_final_soc_jtag_uart_0_alt_jtag_atlantic_jtag_state_sdr                                                                                                     ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_jtag_uart_0_final_soc_jtag_uart_0_alt_jtag_atlantic_jtag_state_udr                                                                                                     ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_jtag_uart_0_final_soc_jtag_uart_0_alt_jtag_atlantic_raw_tck                                                                                                            ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_jtag_uart_0_final_soc_jtag_uart_0_alt_jtag_atlantic_tdi                                                                                                                ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_jtag_uart_0_final_soc_jtag_uart_0_alt_jtag_atlantic_tdo                                                                                                                ; Top       ; Output Port   ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_jtag_uart_0_final_soc_jtag_uart_0_alt_jtag_atlantic_usr1                                                                                                               ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_clr             ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_ena             ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_ir_in_0_        ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_ir_in_1_        ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_ir_out_0_       ; Top       ; Output Port   ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_ir_out_1_       ; Top       ; Output Port   ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_jtag_state_cdr  ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_jtag_state_cir  ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_jtag_state_e1dr ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_jtag_state_e1ir ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_jtag_state_e2dr ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_jtag_state_e2ir ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_jtag_state_pdr  ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_jtag_state_pir  ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_jtag_state_rti  ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_jtag_state_sdr  ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_jtag_state_sdrs ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_jtag_state_sir  ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_jtag_state_sirs ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_jtag_state_tlr  ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_jtag_state_udr  ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_jtag_state_uir  ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_raw_tck         ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_raw_tms         ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_tdi             ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_tdo             ; Top       ; Output Port   ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
; jtag.bp.final_subsystem_nios2_cpu_the_final_soc_NIOS2_cpu_nios2_oci_the_final_soc_NIOS2_cpu_debug_slave_wrapper_final_soc_NIOS2_cpu_debug_slave_phy_sld_virtual_jtag_impl_inst_usr1            ; Top       ; Input Port    ; n/a      ;                                            ;
;                                                                                                                                                                                                ;           ;               ;          ;                                            ;
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+-----------+---------------+----------+--------------------------------------------+


+--------------------------------------------------------------+
; Partition Merge Resource Usage Summary                       ;
+---------------------------------------------+----------------+
; Resource                                    ; Usage          ;
+---------------------------------------------+----------------+
; Estimated Total logic elements              ; 24,419         ;
;                                             ;                ;
; Total combinational functions               ; 22906          ;
; Logic element usage by number of LUT inputs ;                ;
;     -- 4 input functions                    ; 8301           ;
;     -- 3 input functions                    ; 11697          ;
;     -- <=2 input functions                  ; 2908           ;
;                                             ;                ;
; Logic elements by mode                      ;                ;
;     -- normal mode                          ; 13255          ;
;     -- arithmetic mode                      ; 9651           ;
;                                             ;                ;
; Total registers                             ; 3270           ;
;     -- Dedicated logic registers            ; 3270           ;
;     -- I/O registers                        ; 0              ;
;                                             ;                ;
; I/O pins                                    ; 194            ;
; Total memory bits                           ; 26624          ;
;                                             ;                ;
; Embedded Multiplier 9-bit elements          ; 50             ;
;                                             ;                ;
; Total PLLs                                  ; 1              ;
;     -- PLLs                                 ; 1              ;
;                                             ;                ;
; Maximum fan-out node                        ; CLOCK_50~input ;
; Maximum fan-out                             ; 2138           ;
; Total fan-out                               ; 87168          ;
; Average fan-out                             ; 3.25           ;
+---------------------------------------------+----------------+


+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Partition Merge RAM Summary                                                                                                                                                                                                                                                                                                                                                                                                                                                                                   ;
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+------+------------------+--------------+--------------+--------------+--------------+-------+--------------------------------------------------+
; Name                                                                                                                                                                                                                                                                                                                                                         ; Type ; Mode             ; Port A Depth ; Port A Width ; Port B Depth ; Port B Width ; Size  ; MIF                                              ;
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+------+------------------+--------------+--------------+--------------+--------------+-------+--------------------------------------------------+
; final_soc:final_subsystem|avalon_vga_interface:vga_controller_0|VGA_mapper:map|vga_ram:ram1|altsyncram:mem_rtl_0|altsyncram_ugi1:auto_generated|ALTSYNCRAM                                                                                                                                                                                                   ; AUTO ; Simple Dual Port ; 640          ; 32           ; 640          ; 32           ; 20480 ; db/ece385_finalprj.ram0_vga_ram_e844ddfa.hdl.mif ;
; final_soc:final_subsystem|final_soc_NIOS2:nios2|final_soc_NIOS2_cpu:cpu|final_soc_NIOS2_cpu_nios2_oci:the_final_soc_NIOS2_cpu_nios2_oci|final_soc_NIOS2_cpu_nios2_ocimem:the_final_soc_NIOS2_cpu_nios2_ocimem|final_soc_NIOS2_cpu_ociram_sp_ram_module:final_soc_NIOS2_cpu_ociram_sp_ram|altsyncram:the_altsyncram|altsyncram_ac71:auto_generated|ALTSYNCRAM ; AUTO ; Single Port      ; 256          ; 32           ; --           ; --           ; 8192  ; None                                             ;
; final_soc:final_subsystem|final_soc_NIOS2:nios2|final_soc_NIOS2_cpu:cpu|final_soc_NIOS2_cpu_register_bank_a_module:final_soc_NIOS2_cpu_register_bank_a|altsyncram:the_altsyncram|altsyncram_6mc1:auto_generated|ALTSYNCRAM                                                                                                                                   ; AUTO ; Simple Dual Port ; 32           ; 32           ; 32           ; 32           ; 1024  ; None                                             ;
; final_soc:final_subsystem|final_soc_NIOS2:nios2|final_soc_NIOS2_cpu:cpu|final_soc_NIOS2_cpu_register_bank_b_module:final_soc_NIOS2_cpu_register_bank_b|altsyncram:the_altsyncram|altsyncram_6mc1:auto_generated|ALTSYNCRAM                                                                                                                                   ; AUTO ; Simple Dual Port ; 32           ; 32           ; 32           ; 32           ; 1024  ; None                                             ;
; final_soc:final_subsystem|final_soc_jtag_uart_0:jtag_uart_0|final_soc_jtag_uart_0_scfifo_r:the_final_soc_jtag_uart_0_scfifo_r|scfifo:rfifo|scfifo_jr21:auto_generated|a_dpfifo_l011:dpfifo|altsyncram_nio1:FIFOram|ALTSYNCRAM                                                                                                                                ; AUTO ; Simple Dual Port ; 64           ; 8            ; 64           ; 8            ; 512   ; None                                             ;
; final_soc:final_subsystem|final_soc_jtag_uart_0:jtag_uart_0|final_soc_jtag_uart_0_scfifo_w:the_final_soc_jtag_uart_0_scfifo_w|scfifo:wfifo|scfifo_jr21:auto_generated|a_dpfifo_l011:dpfifo|altsyncram_nio1:FIFOram|ALTSYNCRAM                                                                                                                                ; AUTO ; Simple Dual Port ; 64           ; 8            ; 64           ; 8            ; 512   ; None                                             ;
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+------+------------------+--------------+--------------+--------------+--------------+-------+--------------------------------------------------+


+-----------------------------------------------------+
; Partition Merge DSP Block Usage Summary             ;
+---------------------------------------+-------------+
; Statistic                             ; Number Used ;
+---------------------------------------+-------------+
; Simple Multipliers (9-bit)            ; 0           ;
; Simple Multipliers (18-bit)           ; 25          ;
; Embedded Multiplier Blocks            ; --          ;
; Embedded Multiplier 9-bit elements    ; 50          ;
; Signed Embedded Multipliers           ; 8           ;
; Unsigned Embedded Multipliers         ; 3           ;
; Mixed Sign Embedded Multipliers       ; 14          ;
; Variable Sign Embedded Multipliers    ; 0           ;
; Dedicated Input Shift Register Chains ; 0           ;
+---------------------------------------+-------------+
Note: number of Embedded Multiplier Blocks used is only available after a successful fit.


+--------------------------+
; Partition Merge Messages ;
+--------------------------+
Info: *******************************************************************
Info: Running Quartus Prime Partition Merge
    Info: Version 18.1.0 Build 625 09/12/2018 SJ Lite Edition
    Info: Processing started: Thu Nov 28 15:44:08 2019
Info: Command: quartus_cdb --read_settings_files=off --write_settings_files=off ece385_finalprj -c ece385_finalprj --merge=on
Warning (18236): Number of processors has not been specified which may cause overloading on shared machines.  Set the global assignment NUM_PARALLEL_PROCESSORS in your QSF to an appropriate value for best performance.
Info (35007): Using synthesis netlist for partition "Top"
Info (35007): Using synthesis netlist for partition "sld_hub:auto_hub"
Info (35002): Resolved and merged 2 partition(s)
Info (16010): Generating hard_block partition "hard_block:auto_generated_inst"
    Info (16011): Adding 1 node(s), including 0 DDIO, 1 PLL, 0 transceiver and 0 LCELL
Critical Warning (138067): Current license file does not support incremental compilation. The Quartus Prime software removes all the user-specified design partitions in the design automatically.
Warning (15899): PLL "final_soc:final_subsystem|final_soc_PLL:pll|final_soc_PLL_altpll_ieu2:sd1|pll7" has parameters clk4_multiply_by and clk4_divide_by specified but port CLK[4] is not connected File: C:/Users/kpalani/Desktop/ece385_finalprj/final_soc/synthesis/submodules/final_soc_PLL.v Line: 150
Warning (21074): Design contains 2 input pin(s) that do not drive logic
    Warning (15610): No output dependent on input pin "KEY[1]" File: C:/Users/kpalani/Desktop/ece385_finalprj/final_top.sv Line: 13
    Warning (15610): No output dependent on input pin "OTG_INT" File: C:/Users/kpalani/Desktop/ece385_finalprj/final_top.sv Line: 50
Info (21057): Implemented 24985 device resources after synthesis - the final resource count might be different
    Info (21058): Implemented 7 input pins
    Info (21059): Implemented 143 output pins
    Info (21060): Implemented 48 bidirectional pins
    Info (21061): Implemented 24599 logic cells
    Info (21064): Implemented 136 RAM segments
    Info (21065): Implemented 1 PLLs
    Info (21062): Implemented 50 DSP elements
Info: Quartus Prime Partition Merge was successful. 0 errors, 6 warnings
    Info: Peak virtual memory: 4794 megabytes
    Info: Processing ended: Thu Nov 28 15:44:12 2019
    Info: Elapsed time: 00:00:04
    Info: Total CPU time (on all processors): 00:00:04